FPGA培訓(xùn)CPLD培訓(xùn)
概述：<!--[if !vml]--><!--[endif]--> 課程背景 本培訓(xùn)課程主要幫助學(xué)員進(jìn)行 CPLD/FPGA 的系統(tǒng)學(xué)習(xí)，以工程實踐為例，深入探討目前業(yè)界最新、最流行的器件，講授業(yè)界最優(yōu)秀的集成環(huán)境，最簡潔
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<!--[if !vml]--><!--[endif]--> 課程背景
本培訓(xùn)課程主要幫助學(xué)員進(jìn)行 CPLD/FPGA 的系統(tǒng)學(xué)習(xí)，以工程實踐為例，深入探討目前業(yè)界最新、最流行的器件，講授業(yè)界最優(yōu)秀的集成環(huán)境，最簡潔的開發(fā)流程，和業(yè)界最流行的軟處理技術(shù)。每次課程都配有相關(guān)實驗，實驗可以在ALTERA和XILINX兩個公司的FPGA硬件平臺上進(jìn)行，培訓(xùn)學(xué)員可以根據(jù)自身情況選擇開發(fā)環(huán)境。通過實驗，學(xué)員可以更好的理解消化課堂知識，工程實踐水平會得到迅速提高
<!--[if !vml]--><!--[endif]--> 教學(xué)目標(biāo)
培養(yǎng)學(xué)員熟練掌握和使用基于CPLD/FPGA的數(shù)字系統(tǒng)開發(fā)工具、開發(fā)流程（ALTERA和XILINX可選），能夠獨立解決開發(fā)中常見問題，能夠自主進(jìn)行成熟的基于CPLD/FPGA的數(shù)字系統(tǒng)設(shè)計。
<!--[if !vml]--><!--[endif]--> 任課教師
課 程 大 綱
課 程 內(nèi) 容
硬件描述語言(Verilog HDL / VHDL)基本語法和實踐
CPLD/FPGA技術(shù)的發(fā)展歷史階段和代表技術(shù)
CPLD/FPGA 技術(shù)概念和發(fā)展現(xiàn)狀
單片機，CPLD/FPGA，DSP的區(qū)別
與CPLD/FPGA設(shè)計相關(guān)數(shù)字電路基礎(chǔ)知識復(fù)習(xí)
cpld/fpga設(shè)計中幾個基本概念
使用quartusⅡ5.1設(shè)計數(shù)字電路的基本流程
CPLD/FPGA 典型應(yīng)用領(lǐng)域一：替代
[本信息來自于今日推薦網(wǎng)]
本培訓(xùn)課程主要幫助學(xué)員進(jìn)行 CPLD/FPGA 的系統(tǒng)學(xué)習(xí)，以工程實踐為例，深入探討目前業(yè)界最新、最流行的器件，講授業(yè)界最優(yōu)秀的集成環(huán)境，最簡潔的開發(fā)流程，和業(yè)界最流行的軟處理技術(shù)。每次課程都配有相關(guān)實驗，實驗可以在ALTERA和XILINX兩個公司的FPGA硬件平臺上進(jìn)行，培訓(xùn)學(xué)員可以根據(jù)自身情況選擇開發(fā)環(huán)境。通過實驗，學(xué)員可以更好的理解消化課堂知識，工程實踐水平會得到迅速提高
<!--[if !vml]--><!--[endif]--> 教學(xué)目標(biāo)
培養(yǎng)學(xué)員熟練掌握和使用基于CPLD/FPGA的數(shù)字系統(tǒng)開發(fā)工具、開發(fā)流程（ALTERA和XILINX可選），能夠獨立解決開發(fā)中常見問題，能夠自主進(jìn)行成熟的基于CPLD/FPGA的數(shù)字系統(tǒng)設(shè)計。
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課 程 大 綱
課 程 內(nèi) 容
硬件描述語言(Verilog HDL / VHDL)基本語法和實踐
CPLD/FPGA技術(shù)的發(fā)展歷史階段和代表技術(shù)
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